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Diskussion
2 Prozessoren mit gleicher ISA
Cache -Index, Offset, Adressen
Paging
Filterkoeffizienten berechnen
Primitiv rekursive Definition
Boolsche Funktionen
adressierbarer Speicher
Empfänger fehlt beim I2C
Can-bus
Ablauftabelle
NAND Umformung Schaltfunktion
Caches
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Zahlendarstellung\Konversion
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DNFs vereinfachen
Flash-Technologie
Schaltungsentwicklung
Zweidimensionale Parität
Logikminimierung mit KV-Diagra
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RS-FF mittel D-FF
Implikantentafel/ Minimalpoly
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Master Slave FlipFlop
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Konjunktive Normalform
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0-Adress Maschine und Java
1-Adress- Maschine
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Von-Neumann-CPU: LSHIFT
Konjunktive Normalform
MOS Transistor Theorieproblem
Neumann Konzept
Einerkomplement der Zahl 14
Oktett in Hexadezimal
Laufzeitverzögerung Gatter
Signal in Register
Digitale Signale
Neue CPI berechnen
I2C Bus Overhead
Shaonscher Entwicklungssatz
Programm von Schicht Ln ->Ln-2
4 D-Flip-Flops-Schaltung
Fixkommadarstellung addition
9er in 3er System
Funktionale Vollständigkeit
Speicherhierarchie
Threads und Monitore
2er komplementdarstellung
Schaltfunktion mit NAND
Halbaddierer mit Nor-Gattern
Quine und McCluskey Verfahren
log. Gleichung -> Schaltung
Leistungsbewertung CPU's
MIPS - Pipelining: Hazards
4-Wege Assoziativcache
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